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Design IC

慢即是快,快即是慢

 
 
 
 
 
 

双沿触发器的设计实现

2016-3-6 21:26:02 阅读1148 评论0 62016/03 Mar6

 

前言

绝大部分数字逻辑最终是由标准单元实现的,而一般的标准单元里只有单沿触发器,要么上升沿触发,要么下降沿 触发;没有即上升沿触发也下降沿触发的双沿触发器。

作者  | 2016-3-6 21:26:02 | 阅读(1148) |评论(0) | 阅读全文>>

芯片设计漫谈——速度面积功耗一定是折中的吗?

2014-10-22 22:51:53 阅读857 评论0 222014/10 Oct22

在芯片设计中,大家通常都会注意到几个重要的指标:

  1. 速度:电路可以跑多少MHz的时钟频率,一般来说,速度越快,能处理的数据量就越多,性能越好。
  2. 面积:电路的物理实现需要占用硅片的面积,占用的面积越小,成本越低。
  3. 功耗:电路工作所消耗的能量,功耗越低,芯片越省电,发热量 也越低,能耗低,环保。

书本上说,速度、面积、功耗是互相牵制的,在相同的制造工艺(制程)条件下,一般来说,

  1. 速度越快,晶体管尺寸越大,面积就越大,功耗也越高。
  2. 为了降低功耗,可以降低芯片的工作速度,让时钟的跳变频率变慢。
  3. 为了降低成本,减小芯片面积,可以采用面

作者  | 2014-10-22 22:51:53 | 阅读(857) |评论(0) | 阅读全文>>

uvm_tlm_fifo的实现简单模型

2011-3-9 15:39:05 阅读3139 评论0 92011/03 Mar9

对于put_port/put_export; get_port/get_export的模型前面都有介绍,对于这样的直接连接,函数调用的initiator直接指向最终target,不耗费Delta时间。而UVM_TLM_FIFO的引入,提供了内部的put/get的实现同步机制,让消费者和生产者都可以通过port直接调用。不过,带来的效果是,get/put的同步是在tlm_fifo内部的进程进行实现的,通过mailbox的同步来完成,所以会消耗Delta时间。

一个简化的uvm_tlm_fifo实现程序,便于理解tlm_fifo背后的机制。

源代码如下:


作者  | 2011-3-9 15:39:05 | 阅读(3139) |评论(0) | 阅读全文>>

uvm_blocking_get_port/uvm_blocking_get_export实现的简单模型

2011-2-23 8:42:07 阅读1951 评论0 232011/02 Feb23

之前介绍了uvm_blocking_put_port/uvm_blocking_put_export, 其对应的uvm_blocking_get_port/uvm_blocking_get_export的简单模型可以照猫画虎的设计,

源代码如下:


作者  | 2011-2-23 8:42:07 | 阅读(1951) |评论(0) | 阅读全文>>

uvm_blocking_put_port/uvm_blocking_put_imp实现的简单模型

2011-1-13 18:44:02 阅读1699 评论0 132011/01 Jan13

UVM中TLM的使用非常方便,通过简单的connect()函数,就可以将两个不相关的对象紧紧联系在一起。为什么会如此简单,其背后的原理是什么呢?今天抽空分析了UVM的源代码,基本上了解了put_port/put_imp的实现机制。于是借用UVM的实现原理,我简单了编写了一个小程序,抛掉不必要的繁文缛节,基本上能够展示其背后的实现原理。

代码如下:

作者  | 2011-1-13 18:44:02 | 阅读(1699) |评论(0) | 阅读全文>>

SystemVerilog——类的继承

2010-11-11 8:40:11 阅读2243 评论0 112010/11 Nov11

今天翻译了一个重要概念:类的继承

来源:http://systemverilog.co/wiki/Class_Inheritance


类的继承


作者  | 2010-11-11 8:40:11 | 阅读(2243) |评论(0) | 阅读全文>>

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金鸡湖边,沉沦芯片,执着设计。
 
近期心愿淡定,沉着,冷静,却依然保持激情。
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